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2013年5月 5日 (日)

Load Transient Response Testing for Voltage Regulators

Linear Tecnology Application Note 104

Jim Williams
オリジナルの回路図です。
POWER MOS FETをドライブするために高出力電流
ハイスルーレートの電流帰還型のOPAを使用しています。
DC Biasをサミングしてバイアス電流を0-1Aの範囲で加算できます。
これは便利に使えると考えて作ってみました。
20130505_82249
外観の写真です。
左からパルスを入力します。
右上(50ohm)がドレン出力で
その下が0.1Ωのモニター出力です。
ダイアルがDC Baisで0〜10V(0〜1A)可変。
放熱器部分が被試験レギュレータです。
差し込み式になっています。
20130505_83059
LM7805に200mAを流しておいて
100mAのステップを入力した時の応答波形です。
20130505_81709

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